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七进制同步加法计数器-课程设计-毕业论文

上传者:科技星球 |  格式:doc  |  页数:15 |  大小:0KB

文档介绍
根据图9:串行序列发生器的状态图可画出输出Y的卡诺图,如下图所示:РQQР10Р11Р01Р00РQР0Р1РXРXР0Р1Р1Р0Р0Р1Р图10:串行序列发生器输出的卡诺图Рb.根据图9:串行序列发生器的状态图可画出图11:串行序列发生器次态卡诺图,如下图所示:РQQР10Р11Р01Р00РQР001Р100РXXXРXXXР101Р110Р000Р111Р0Р1Р图11:串行序列发生器次态的卡诺图Рc.Q2n+1的次态卡诺图:РQQРQР0Р1РXРXР1Р1Р0Р1Р10Р11Р01Р00Р0Р1Р图12:Q2n+1的卡诺图Рd.Q1n+1的次态卡诺图:РQQРQР0Р0РXРXР0Р1Р0Р1Р10Р01Р11Р00Р0Р1Р图13:Q1n+1的卡诺图Рe.Q0n+1的次态卡诺图:РQQРQР1Р0РXРXР1Р0Р0Р1Р10Р11Р01Р00Р0Р1Р图14:Q0n+1的卡诺图Р(3)输出方程:Р根据输出Y卡诺图可得:输出Y=QР(4)状态方程:Р根据卡诺图写出状态方程为РQ2n+1=QQQ+QQ+QQ=QQQ+QQQРQ1n+1=QQQ+QQ=QQQ+QQР Q0n+1=QР(5)驱动方程:РJK触发器特性方程为:Q=JQn+KQn Р J2=QQ K2=QQ Р J1=QQ K1=QР J0=1 K0=1Р2.3.2检验Р检查电路能否自启动:Р将无效态(010;011)代入状态方程进行计算得:Р/1Р/0РO10 011 000(有效状态)Р可见,所设计的时序电路能够自启动。Р2.3.3实验仪器Р1)数字原理实验系统一台Р2)集成芯片:74LS08 一片;74LS112 两片。Р3)导线若干Р2.4(仿真)结果分析Р2.4.1逻辑电路图Р根据所选用的触发器和时钟方程、输出方程、驱动方程,可画出串行序列发生器的逻辑电路图:Р图15:串行序列发生器逻辑电路图

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