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08课程设计多功能数字钟 verilog语言暑期实习石油大学

上传者:叶子黄了 |  格式:doc  |  页数:28 |  大小:635KB

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ge clkout1)Рbegin Рreset=s8;Рss1=s1;Рss2=s2;Р endРalways@(posedge clkout3)Рbegin Рif(t1==1) led=~led;else if(t1==0) led=0;//当t1=1时闪烁,否则不闪Р endРendmoduleР控制器仿真源文件:Р图7控制器仿真源文件Р说明:clkout1的周期是clkout3的一倍。s1、s2、s3均有0和1出现,t1之后为1Р控制器仿真输出文件:Р图8控制器仿真输出文件Р说明:从图中可以看出s1、s2、s3的值分别赋给了ss1、ss2、reset。Led在t1为1时闪烁。Р3.计时器设计方案Р计数器输出端口shis表示小时的十位,shig表示小时的各位,mins表示分钟的十位,ming表示分钟的个位。secs表示秒的十位,secg表示秒的个位。Р设计思路:判断ss1是否为0,若为0,小时加1或归0。同时判断ss2是否为0,若为0,则分钟加1或归0并进1。同时判断reset是否为0,若为0,全部归0。若不为 0则嵌套if语句判断sec、min、shi的值并进行加1或归0操作。当59分54秒到59秒时让t1为1,灯闪烁。其他时候t1为0,灯灭。Рmodule jishu(clkout1,ss1,ss2,reset,shis,shig,mins,ming,secs,secg,t1);Рinput clkout1,ss1,ss2,reset;// clkout1为1赫兹,ss1、ss2、reset是储存的s1、s2、s8的值Рoutput[1:0] shis;//小时的十位Рoutput[3:0] shig;//小时的个位Рoutput[2:0] mins;//分钟的十位Рoutput[3:0] ming;//分钟的个位Рoutput[2:0] secs;//秒的十位

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